益華新款合成解決方案提升RTL設計生產力

2015 年 06 月 16 日

益華(Cadence)推出新款暫存器轉移層次(RTL)合成與實體合成引擎–Cadence Genus合成解決方案,用於解決RTL設計所面臨的生產力難題。該合成解決方案採用多層次大規模平行架構,使合成週轉時間加速五倍並線性擴充至一千萬instances以上大的設計。此外,軟體中最新實體意識內容生成功能,可降低單元層次與晶片層次之間合成反覆率達兩倍以上。


Cadence數位Signoff與Signoff事業群資深副總裁暨總經理Anirudh Devgan表示,透過新款合成解決方案,可見到改善RTL設計生產力的契機,也能以提升的架構層次最佳化作業有效改善PPA,先期客戶們已於其RTL設計流程中採用此解決方案,同時也證實此解決方案的週轉時間與產出量均領先其他同級解決方案。


Genus合成解決方案的主要功能與特色包括,可於多重核心與機器之間執行時序驅動型分散式合成作業,合成流程中所有主要步驟均能有效運用多部機器與各機器中的多重CPU核心;設計中任何子集的完整時序與實體內容均可擷取,並於全面考量晶片層次時序與布局下用於驅動RTL單元層次合成作業,藉此減低晶片層次與單元層次合成週期的反覆率;透過Innovus設計實現系統整合全域繞線作業;全域解析式架構層次PPA最佳化作業。


Cadence網址:www.cadence.com

標籤
相關文章

安捷倫推出GoldenGate 2011 RFIC模擬軟體

2011 年 04 月 19 日

益華發表USB SSIC規格專屬驗證IP

2013 年 02 月 09 日

益華推出新一代JasperGold形式驗證平台

2015 年 06 月 23 日

益華/ARM簽署協議擴大系統晶片設計合作

2014 年 10 月 13 日

益華時序簽核方案助力逾兩百件設計定案

2016 年 02 月 05 日

益華Allegro SiP和PVS技術滿足台積公司InFO封裝

2015 年 10 月 08 日
前一篇
落實端到端系統防護措施 物聯網安全滴水不漏
下一篇
Altera新款FPGA提升性能/整合度/安全性